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½«RTL Èà´ê³ÉGDS; оƬÉú²úÓÉÓÚÌ«¹ý¸´ÔÓ£¬ÍêÈ«½»ÓÉ´ú¹¤³§Íê³É£¬·â×°ÒàÊÇ£»¶ÔÓÚ²âÊÔ£¬´ó²¿·Ö¹«Ë¾¶¼ÊÇ×â½èµÚÈý·½²âÊÔ»ų̀ÓÉ×Ô¼ºµÄ²âÊÔ¹¤³ÌʦÍê³É£¬Ö»ÓÐÉÙ²¿·ÖÍÁºÀ¹«Ë¾²Å»áÓÐ×Ô¼ºµÄ²âÊÔ»ų̀¡£

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ËÆºõûÓÐEDA ¹¤¾ßÓÃÓڼܹ¹Éè¼Æ£»¼Ü¹¹Çö¨ÁËÖ®ºó£¬´óÁ¿µÄËã·¨¹¤³Ìʦ¸úÉÏ£¬¶ÔÓÚÐÒ鹿¶¨µÄÿ¸öµã£¬¶¼ÒªÑ¡ÔñÊʵ±µÄËã·¨£¬ÓÃC/C++
×ö¾«È·Ä£Äâ·ÂÕæ£¬ÒªÈ·±£¹¦ÄÜ¡¢¾«¶È¡¢Ð§ÂÊ¡¢ÍÌÍÂÁ¿µÈÖ¸±ê£¬Matlab ¸úGCC Ó¦¸ÃÊÇËûÃÇʹÓÃ×î¶àµÄ¹¤¾ß¡£

Éè¼Æ¹¤³Ìʦ¸ù¾ÝËã·¨¹¤³Ìʦ¾¹ý·´¸´Ä£Äâ·ÂÕæÑ¡ÔñµÄËã·¨£¬½«³éÏóÃèÊö»ò¶¨µãC ת»»³ÉRTL, ÔÚÉè¼Æ¹ý³ÌÖÐÐèÒª·´¸´·ÂÕæ¡¢×ۺϣ¬ÒÔÈ·¶¨Éè¼Æ¹¦ÄܵÄÕýÈ·ÐÔ£¬¸úÉè¼ÆÄÜ´ïµ½µÄPPA.
³ýÁËRTL, Éè¼Æ¹¤³Ìʦ»¹ÐèÒª¸ù¾ÝÉè¼ÆÄ¿±ê±àдSDC ºÍpower intent, ²¢×ö¶ÔÓ¦µÄÖÊÁ¿¼ì²é¡£Éè¼Æ¹¤³ÌʦÐèҪʹÓôóÁ¿EDA
¹¤¾ß£º
±à¼Æ÷£ºVIM, emac;
Lint : RTL ÖÊÁ¿¼ì²é£¬Spyglass, Jasper;
CDC: SDC ÖÊÁ¿¼ì²é£¬Spyglass, Conformal, GCA;
CPF/1801: power intent ÖÊÁ¿¼ì²é£¬CLP;
Power: RTL ¼¶¹¦ºÄ·ÖÎö£¬Joules, PA;
·ÂÕæÆ÷£ºC, S, M Èý¼Ò¶¼Óи÷×ԵķÂÕæ¹¤¾ß;
×ۺϣºGenus, DC;

´Ó¼¯³É¿ªÊ¼£¬ÓÉÄÔÁ¦ÀÍ×÷½øÈëÌåÁ¦ÀÍ×÷£¬¶Ô±È¸Ç·¿×Ó£¬¾ÍÊÇ´ÓÉè¼ÆÊ¦µ½ÄàÍß¹¤¡£¼¯³É¹¤³Ìʦ£¬Òª°ÑоƬËùÓõÄËùÓÐÄ£¿éÏ໥Á¬½ÓÆðÀ´£¬Ö¸µ¼Ë¼ÏëÊǼܹ¹¹¤³Ìʦȷ¶¨µÄ£¬¸÷¸öIP
ÈçºÎÁ¬½ÓÊǸ÷IP µÄowner È·¶¨µÄ£¬¼¯³É¹¤³ÌʦֻҪ±£Ö¤²»¶àÁ¬¡¢²»ÉÙÁ¬¡¢²»ÂÒÁ¬¼´¿É£¬¾Ý˵µ±Ç°Ò²Ã»ÓÐʲôÓÐЧµÄ¼¯³É¹¤¾ß£¬³£Óõ½µÄÊÇemac¡£
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½Ó×ÅÞÛ£¬Êµ¼ÊÏîÄ¿ÖÐÑéÖ¤¸ú×ۺϴÓRTL coding ¿ªÊ¼¾Í»á½»²æ½øÐУ¬·´¸´µü´ú¡£
ÑéÖ¤ÔÚÊý×ÖоƬÉè¼ÆÖÐÕ¼ºÜ´ó±ÈÀý£¬½üЩÄêÔÚÉè¼Æ¸´ÔӶȵÄÍÆ¶¯ÏÂÑéÖ¤·½·¨Ñ§¸úÑéÖ¤ÊÖ¶ÎÔÚ²»¶Ï¸üУ¬´ÓOVM
µ½UVM, ´ÓDynamic verification µ½Static verification,
´ÓFPGA µ½Emulator, ËùÓиïÐÂÄ¿µÄ¿É¸ÅÀ¨Îª£º¿ìËÙ¡¢Í걸¡¢Ò×µ÷ÊÔ¡£Ñé֤ɿ¼°µ½Ðí¶à·½Ã棬ÑéÖ¤¹¤³Ìʦһ·½ÃæÒª¶ÔÏà¹ØÐÒéËã·¨ÓÐ×ã¹»Á˽⣬¸ù¾Ý¼Ü¹¹¡¢Ëã·¨¹¤³ÌʦÉ趨µÄÄ¿±êÉè¼Æ·ÂÕæÏòÁ¿£»ÁíÒ»·½ÃæÒª¶ÔÉè¼Æ±¾Éí×ã¹»Á˽⣬ÒÔÌá¸ßÑé֤ЧÂÊ£¬Ëõ¶ÌÑé֤ʱ¼ä¡£ÑéÖ¤¹¤³ÌʦÐèÒªÕÆÎÕÐí¶à¼¼Êõ£¬ÐèҪʹÓÃÐí¶à¹¤¾ß¡£
ÓïÑÔ£º¸÷Öֽű¾ÓïÑÔÖ®Í⣬C/C++, SystemVerilog, Verilog£»
ÐÒ飺¸÷ÖÖ½Ó¿ÚÐÒ飬¸÷ÖÖͨÐÅÐÒ飬¸÷ÖÖ×ÜÏßÐÒ飻
¹¤¾ß£º¶¯Ì¬·ÂÕæ¹¤¾ß£¬¾²Ì¬·ÂÕæ¹¤¾ß£¬FPGA, Emulator£»
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Verdi, Modelsim ÆäËû¼¸ºõÎÞÖª£¬´Ë´¦ÄÃC ¼ÒÑé֤ȫÌ×ΪÀý¡£
Static Verification: Jasper Gold ÊÇC ¼ÒнüÍÆ³öµÄ¾²Ì¬ÑéÖ¤¹¤¾ß£¬Â¿ËùÀí½âµÄ¾²Ì¬ÑéÖ¤ÊÇ»ùÓÚ¶ÏÑÔµÄÑéÖ¤·½·¨Ñ§£¬Ëùν¾²Ì¬¼´²»ÐèÒªÊäÈë²âÊÔ¼¤Àø£¬ÑéÖ¤¹ý³ÌÊÇ´¿ÊýѧÐÐΪ¡£
Dynamic Verification: Xcelium ÊÇC ¼ÒµÄ¶¯Ì¬ÑéÖ¤¹¤¾ß£¬Â¿ËùÀí½âµÄ¶¯Ì¬ÑéÖ¤ÊÇ»ùÓÚUVM
µÄÑéÖ¤·½·¨Ñ§£¬Í¨¹ýÊäÈë²âÊÔ¼¤Àø£¬¼à¿Ø·ÂÕæ½á¹û£¬·ÖÎö¸²¸ÇÂÊÍê³É¹¦ÄÜÑéÖ¤¡£
Emulator: Ó²¼þ·ÂÕæ¼ÓËÙÆ÷£¬´Ö±©Àí½â£ºÓÐdebug ¹¦ÄܵÉÁ˷ḻ½Ó¿ÚµÄ¾ÞÐͿɱà³ÌÕóÁУ»Ìص㣺³¬¸ßËÙÑéÖ¤¡¢Ö§³ÖϵͳÈí¼þµ÷ÊÔ¡£ÅÁÀ¶¡ÊÇC
¼ÒÔÚÑéÖ¤ÁìÓòµÄÃ÷ÐDzúÆ·£¬ÊÇÐÐÒµÇ̳þ£¬¾Ý˵³£ÓÐÇÕ²îݰÁٹ賧ÔÚÅÁÀ¶¡Ç°×¤×ãÁ¼¾Ã£¬ÉÍÆäÍâÐÎÖ®ÃÀ£¬ÔÞÆä¹¦ÄÜ֮ǿ¡£
Verification IP: ÑéÖ¤ÐèÒª¸÷ÖÖÑé֤ģÐÍ£¬¸÷ÖÖIP, ¸÷ÖÖ×ÜÏߣ¬¸÷ÖÖ¸ßËÙ½Ó¿Ú¡£
FPGA µÄÒ»´óÓ¦ÓÃÊÇÑéÖ¤£¬¹ÊÌáÒ»×ì¡£ÔÚÊÀÉÏÔø¾ÓÐÁ½¼ÒÅ£±ÆÉÁÉÁµÄFPGA ¹«Ë¾£¬Ò»¼ÒÊÇAltera
ÁíÒ»¼ÒÊÇXilinx, ºóÀ´Altera ÏñMentor Ò»ÑùÕÒÁ˸ö´óÒ¯°Ñ×Ô¼ºÂôÁË¡£FPGA ÄÚ³ýÁ˿ɱà³ÌÂß¼Ö®Í⣬ͨ³£»¹»á¼¯³É¸÷ÖÖIP,
ÈçCPU, DSP, DDR controller µÈ¡£Ã¿¼ÒFPGA ¶¼Óи÷ÖÖÅäÖ㬸ù¾Ý¼¯³ÉµÄIP,
¿É±à³ÌÂß¼µÄ¹æÄ££¬¿É´ïµ½µÄËÙ¶È£¬¼Û¸ñÏà²î¼«´ó¡£Ïà¶ÔÓÚASIC, FPGA Ò²ÓÐÒ»Ì×¶ÔÓ¦µÄEDA ¹¤¾ß£¬ÓÃÓÚ×ۺϡ¢²¼¾Ö²¼Ïß¡¢ÉÕ¼¡¢µ÷ÊÔ¡£È磺Synplify,
Quartus¡£
¹úÄÚÏÖ×´£ºStatic Verification, Dynamic Verification, Emulator
¼¸ºõ¿Õ°×£»¹úÄÚÓÐһЩFPGA ¹«Ë¾£¬ÔÚÖеͶËÁìÓòÒѾ×öµÃ·Ç³£²»´í£¬µ«ÊǸ߶ËÁìÓò¼¸ºõ¿Õ°×¡£ÈÎÖØ¶øµÀÔ¶£¬²»½ÃÊΣ¬½Å̤ʵµØ¸É£¡
ʵÏÖ
½Ó×ÅÉÏÃæËµµÄÎÒÃǼÌÐøÞÛÊý×ÖоƬÉè¼ÆÊµÏÖÁ÷³Ì£¬½ñÌì½øÈëʵÏֽ׶Σ¬¶ÔÓÚÕâÒ»¶Î¿ֻÊìϤÆäÖеÄ×ۺϡ¢ÐÎʽÑéÖ¤¡¢µÍ¹¦ºÄÑéÖ¤¡¢RTL
¹¦ºÄ·ÖÎö¡¢STA, ÆäËû²¿·Ö¶¼ÊÇÒ»Öª°ë½â£¬¹ÊÎÞÉ£¬Ö»ÞÛÁ÷³Ì¡£
Õû¸öʵÏֽ׶Σ¬¿ÉÒÔ¸ÅÀ¨³ÉÍæEDA ¹¤¾ß¼°»ùÓÚEDA ¹¤¾ßµÄ·½·¨Ñ§£¬EDA ¹¤¾ßÎÞÒÉÊÇʵÏֽ׶εÄÖ÷µ¼£¬Ò»¿ÅоƬ×öµÃºÃ²»ºÃ£¬ÔÚʵÏÖ½×¶Î֮ǰ»ù±¾È¡¾öÓÚ¹¤³ÌʦµÄÄÜÁ¦Ç¿²»Ç¿£¬¶øÔÚʵÏÖ½×¶ÎÖ®ºó»ù±¾È¡¾öÓÚEDA
¹¤¾ßÍæµÃºÃ²»ºÃ¡£Õû¸öÉè¼ÆÊµÏÖÁ÷³Ì£¬Éæ¼°µ½Ðí¶à¹¤¾ß£¬´Ë´¦ÁгöËļÒÖ÷Òª²ÎÓëÕߣ¬¿Õ°×²¿·Ö²»´ú±íûÓУ¬Ö»´ú±í¿²»Öª¡£
Êý×Öµç·ʵÏÖÁ÷³Ì£¬´Ó´ó·½ÏòÉÏ¿ÉÒÔ·Ö³ÉÁ½²¿·Ö£ºÓÅ»¯¸úÑéÖ¤¡£ÓÅ»¯£¬»á¸ü¸ÄÂß¼ÃèÊö·½Ê½£¬»á¸ü¸ÄÂß¼½á¹¹£¬»á²åÈëÐÂÂß¼£¬ÕâËùÓе͝×÷¶¼´æÔÚÒýÈë´íÎóµÄ·çÏÕ£¬¹ÊÐèÒªÑéÖ¤¹¤¾ßÓèÒÔ¼à¿Ø£»ÑéÖ¤£¬ÒªÈ·±£Âß¼ÓÅ»¯¹ý³Ì²»¸Ä±äÂß¼¹¦ÄÜ£¬ÒªÈ·±£Ê±ÐòÂú×ã¼È¶¨Ä¿±êÐèÇó£¬ÒªÈ·±£ÎÞÎïÀí¹æÔòÎ¥¹æ£¬ÒªÈ·±£ÐźÅÍêÕûÐÔ£¬ÕâËùÓеÄÑéÖ¤¶¼ÓÐÒ»Ì×¶ÔÓ¦µÄͨ¹ý¹æÔò£¬µ«·²ÓÐijһÏî²»´ï±ê£¬¾Í²»ÄÜÄÃÈ¥Éú²úÖÆÔì¡£
¸ß¼¶×ۺϣºËùνµÄ¸ß¼¶×ۺϾÍÊǽ«C/ C++/ System CÃèÊöµÄÉè¼ÆÒâͼ£¬¡°·Ò롱³ÉÓÃVerilog/
System Verilog ÃèÊöµÄRTL, ¶àÓ¦ÓÃÓÚÔËËãÂß¼Ö÷µ¼µÄÉè¼Æ£¬³ýÁËÈý¾ÞÍ·£¬ÊÐÃæÉÏÓÐÐí¶àС¹«Ë¾ÔÚÕâÒ»¸öµãÉÏÒ²×öµÃ²»´í¡£
×ۺϣºÔÚʵÏÖÁ÷³ÌÖУ¬¾Í±³ºóËã·¨¶øÑÔ£¬×ÛºÏÒ»¶¨ÊÇ×îÄÑ×Ôӵġ£×ÛºÏÊ×ÏȽ«Verilog/ System
Verilog/ VHDL ÃèÊöµÄÂ߼ת»¯³ÉÓÉGtech ÃèÊöµÄÂß¼£¬ÔÙ¶ÔGtech Âß¼×öÓÅ»¯£¬ÓÅ»¯ºóÔÙ½«Gtech
ÃèÊöÓ³Éäµ½¶ÔÓ¦¹¤ÒÕ¿â¡£ÆäÖÐÓÅ»¯¹ý³ÌÉæ¼°µ½¶à¸ö·½Ã棬½üÄêÀ´EDA ¹¤¾ßµÄ·¢Õ¹·½Ïò»ù±¾¿ÉÒÔ¸ÅÀ¨Îª£ºÈÝÁ¿£¬ËÙ¶È£¬Ïà¹ØÐÔ¡£ÈÝÁ¿£ºÖ¸¿É´¦ÀíµÄÉè¼Æ¹æÄ££»ËÙ¶È£ºÖ¸EDA
¹¤¾ßµÄÓÅ»¯ËÙ¶È£»Ïà¹ØÐÔ£ºÖ¸¸ú²¼¾Ö²¼ÏßÖ®¼äµÄÏà¹ØÐÔ¡£Ö÷Á÷¹¤¾ß£ºGenus, Design Compiler.
ÔÚÕâÒ»µãÉÏ£¬¼¸ºõÔÙÄÑÓкóÆðÖ®Ð㣬³ý·ÇÓг¯Ò»ÈÕ£¬Õû¸öÊý×ֵ緵ÄÉè¼Æ·½·¨Ñ§·¢Éúµß¸²ÐԵĸïС£
DFT: ²åÈëѹËõ½âѹËõÂß¼£¬²åÈëscan chain, ²åÈëMbist, ²åÈëLbist, ²åÈëBoundary
Scan, ²åÈëOCC, ²åÈëTest Point, Éú³ÉATPG pattern, ¹ÊÕÏÕï¶Ï£¬DFT
¹¤³ÌʦÏñÀÏÖÐÒ½²åÈë¡¢¹Û²ì¡¢Õï¶Ï¡£µ±½ñÊÐÃæÉÏDFT ¹¤³Ìʦ½ôȱ£¬¹ó£¡Ö÷Á÷¹¤¾ß£ºTessenst, Modus,
TetraMax.
ECO: µ«·²ÓÐÐµĶ«Î÷ÒýÈ룬¾Í¿ÉÄÜÒýÈëbug, ÔçÆÚ·¢ÏÖbug ¿ÉÒÔÖØÐÂ×ßÒ»±éʵÏÖÁ÷³Ì£¬Èç¹ûÔÚºóÆÚ·¢ÏÖbug
ÖØ×ßÒ»±éÁ÷³ÌµÄ´ú¼ÛÌ«´ó£¬Í¨³£µÄ×ö·¨¾ÍÊÇECO. ¶ÔÓÚ¼òµ¥µÄbug ÐÞ¸´ÊÖ¹¤ECO ¾Í¿ÉÒÔ£¬µ«ÊǶÔÓÚ¸´ÔÓµÄbug
ÐÞ¸´£¬ÊÖ¹¤ECO ÓÐÐÄÎÞÁ¦£¬¹ÊÐèÒªÓÐEDA ¹¤¾ßÀ´Íê³ÉÏàÓ¦µÄ¹¤×÷¡£µ±Ç°ÊÀÃæÉÏ×îºÃÓõÄ×Ô¶¯ECO ¹¤¾ß·ÇConformal
ECO ĪÊô¡£×î½üÒ²ÓÐһЩstartup ×ö¶ÔÓ¦µÄµã¹¤¾ß£¬Õû¸ö˼·¸úCECO ÀàËÆ£¬µ«ÊÇûÓÐ×Ô¼ºµÄ×ۺϹ¤¾ßÓÅ»¯ECO
ºóµÄ²¹¶¡£¬¾ÍºÜÄѵõ½Ò»¸öºÃµÄ½á¹û¡£
²¼¾Ö²¼ÏߣºÔÚ½øÈëÄÉÃ×ʱ´ú֮ǰ£¬²¼¾Ö²¼Ïß²¢Ã»ÄÇô¸´ÔÓ£¬´Ó90nm ¿ªÊ¼µ½Èç½ñµÄ3nm£¬²¼¾Ö²¼Ïߵĸ´ÔӶȳÊÖ¸ÊýÔö³¤£¬´Ófloorplan
µ½placement µ½CTS µ½Routing ÿһ²½Éæ¼°µ½µÄËã·¨ÔÚ½üÄê¶¼×öÁ˵߸²ÐԵĸïУ¬ÒÔInnovus
µÄÎÊÊÀΪÆðµã£¬²¼¾Ö²¼Ïß½øÈëµ½ÁËÒ»¸öмÍÔª¡£ÔÚAI µÄÀ˳±ÏÂC ¸úS ¶¼Ò»Í·ÔúÁ˽øÈ¥£¬Òª×öÊÀÉÏ×îÖÇÄܵIJ¼¾Ö²¼Ïß¹¤¾ß£¬Ò²ÐíÓг¯Ò»ÈÕ¿ÉÒÔÏñ¸úС¶È¶Ô»°Ò»Ñù£º
¹èÅ©£ºInnovus Çë½âÎöA Îļþ£¬°´É趨Ŀ±ê×ö¸ö¹¦ºÄ×îÓŵĽá¹û£»
Innovus: ÒѶÁȡĿ±êÎļþ£¬¸ù¾ÝÉè¼ÆÊý¾Ý·ÖÎö£¬±¾Éè¼Æ´ó¸ÅÐèÒª250G Äڴ棬ÔÚ5СʱÄÚÍê³É£¬ÇëÑ¡ÔñÈÎÎñÍê³ÉºóÊÇ·ñ×Ô¶¯½øÈëºóÐø³ÌÐò......
RTL ¹¦ºÄ·ÖÎö£ºÕâÒ»²½¿ÉÒÔ·ÅÔÚʵÏÖ¶Ë×öÒ²¿ÉÒÔ·ÅÔÚʵÏÖ֮ǰ×ö¡£·ÖÎö¹ý³ÌÏà¶Ô¼òµ¥£º¶ÁÈëRTL, SDC,
·ÂÕæ¼¤Àø£¬Í¨¹ý¼ÆËã·ÖÎöƽ¾ù¹¦ºÄ¸ú˲ʱ¹¦ºÄ£¬ÕÒ³öÉè¼ÆÖеġ°¹¦ºÄȱÏÝ¡±£¬Ö¸µ¼Designer ½øÐй¦ºÄÓÅ»¯¡£Ö÷Á÷¹¤¾ßÓУºJoules,
Spyglass, PowerArtist.
ÐÎʽÑéÖ¤£ºÔÚÕû¸öʵÏÖÁ÷³ÌÖУ¬ÐÎʽÑéÖ¤³äµ±Âß¼¹¦ÄܵÈЧÐԵļà²ì¹Ù£¬ÈκÎÒ»²½ÓÅ»¯½áÊøºó¶¼ÐèÒª¹ýÐÎʽÑéÖ¤ÕâÒ»¹Ø£¬ÒÔÈ·±£ÔÚÓÅ»¯¹ý³ÌÖУ¬Âß¼¹¦ÄÜδ±»¸Ä±ä¡£Ö÷Á÷¹¤¾ß£ºLEC,
Formality. Ëæ×ÅÉè¼Æ¹æÄ£µÄ±©Ôö¸úÓÅ»¯¼¼ÊõµÄ·ÉËÙ·¢Õ¹£¬ÐÎʽÑéÖ¤µÄÄѶÈÖð½¥Ôö¼Ó£¬Õ¼ÓõÄʱ¼äÖð½¥Ôö¶à£¬SmartLEC
ÊÇÕë¶Ô¸´ÔÓÉè¼ÆµÄÏÈÐÐÕß¡£
µÍ¹¦ºÄÑéÖ¤£ºÕë¶ÔµÍ¹¦ºÄÉè¼Æ£¬µÍ¹¦ºÄÑéÖ¤ÒªÑéÖ¤CPF/ UPF/ 1801 µÄÓï·¨ÓïÒå¸úÃèÊöÒâͼ£¬ÒªÑéÖ¤µÍ¹¦ºÄµ¥ÔªÎ´¶à²å£¬Î´Â©²å£¬Î´ÂҲ壬ҪÑéÖ¤µçÔ´¸úµØµÄÁ´½Ó·ûºÏÉè¼ÆÒâͼ£¬ÒªÑéÖ¤µçÌØÐÔµÄÍêÕûÐÔ¡£Ö÷Á÷¹¤¾ß£ºCLP¡£
STA: Timing signoff, STA ¿´ËÆÅÓÔÓ£¬Æäʵ²¢²»¸´ÔÓ£¬Ïà±ÈÓÚÓÅ»¯¹ý³ÌÒª¼òµ¥µÃ¶à£¬Å׿ªTiming
ECO, STA ËùÓе͝×÷¶¼Ö»ÊǼÆËã¶ø²»ÊÇÇó½â£¬²»Ç¡µ±µÄ±È·½£ºSTA ¾ÍºÃ±ÈÓ×¶ùÔ°µÄËãÊõÌ⣬¼ÓÊý¸ú±»¼ÓÊý¶¼ÔÚÄÇÀֻҪÇó¸öºÍ¼´¿É£»¶øÓÅ»¯¹ý³ÌÊÇÇó×îÓŽâ»ò½üËÆ×îÓŽâµÄ¹ý³Ì£¬ÒªÄѵöࡣ½üÄêÀ´STA
EDA ¹¤¾ßÖ÷ÒªÔÚ¼¸¸ö·½Ïò×ÅÁ¦£ºÈçºÎÄ£ÄâÖÆÔì¹ý³ÌµÄËæ»ú¹¤ÒÕÆ«²î£¬ÈçºÎ´¦Àí³¬´ó¹æÄ£Éè¼Æ£¬ÈçºÎÄ£Äâй¤ÒÕ½áµãµçÌØÐÔ¶ÔʱÐòµÄÓ°Ïì¡£
Power Signoff: ÑéÖ¤Éè¼ÆµÄµçÔ´ÍøÂçÊÇ·ñ×㹻ǿº·£¬·ÖÎö£¬·¢ÏÖ£¬ÐÞÕý£ºIR-drop ¸úEM.
Ö÷Á÷¹¤¾ß£ºVoltus, RedHawk.
ÎïÀíÑéÖ¤: ÑéÖ¤ËùÓеĹÜ×Ó¡¢¹ý¿×¡¢×ßÏßÊÇ·ñÂú×ãFoundry ÖÆ¶¨µÄ¹æÔò£¬ÊǸöÌåÁ¦»î£¬ÓеãÏñ¸ÇºÃ·¿×ÓÖ®ºóµÄÀ¬»øÇåÀí£¬Ö÷Á÷¹¤¾ß£ºCalibre,
PVS, ICV.
Õû¸öÊý×ÖʵÏÖÁ÷³ÌÖÐÉæ¼°µ½Öî¶à¹¤¾ß£¬Èý¾ÞÍ·ÔÚÁìÅÜ£¬ºóÃæ»ù±¾Ã»ÓиúËæÕߣ¬Å¼¶ûÓÐij¸öµã¹¤¾ß×öµÃºÃµÄºóÆðÖ®Ð㣬´ó¶à¶¼»á±»Èý¾ÞÍ·³ÔÁË£¬ÕâÒ²ËãÊÇÐÐÒµÌ×·¡£¾ÍÊÐÖµ¿´£¬Èý¾ÞÍ·¼ÓÆðÀ´À´Ò²²»¼°»¥ÁªÍø¹«Ë¾Ò»ÌõÍÈ´Ö£¬È»¶øÔÚÕû¸öоƬÉè¼ÆÊµÏÖ¹ý³ÌÖÐÈ´²»¿É»òȱ£¬Îá¹úҪǿ´óоƬ²úÒµ£¬±ØÐëÒªÔÚEDA
ÕâÒ»¿é¼Ó´óͶÈ룬·½ÄÜÀëÍÑÀë±»Æþ×Ų±×Ó×߸ü½øÒ»²½¡£
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