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 2018-2-8 
 
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1.FPGA¸ÅÊö

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2.FPGAоƬ½á¹¹

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2.1 IOE

IOEÊÇоƬÓëÍⲿµç·µÄÎïÀí½Ó¿Ú£¬Ö÷ÒªÍê³É²»Í¬µçÆøÌØÐÔÏÂÊäÈë/Êä³öÐźŵÄÇý¶¯ÓëÆ¥ÅäÒªÇ󣬱ÈÈç´Ó»ù±¾µÄLVTTL/LVCMOS½Ó¿Úµ½PCI/LVDS/RSDSÉõÖÁ¸÷ÖÖ¸÷ÑùµÄ²î·Ö½Ó¿Ú£¬´Ó5V¼æÈݵ½3.3V/2.5V/1.8V/1.5VµÄµçƽ½Ó¿Ú£¬ÏÂÃæÊÇALTERA¹«Ë¾µÄCyclone IV EP4CE115F29É豸µÄIOE½á¹¹

ͼ1 EP4CE115F29É豸µÄIOE½á¹¹Í¼

FPGAµÄIOE°´×é·ÖÀ࣬ÿ×é¶¼Äܹ»¶ÀÁ¢µØÖ§³Ö²»Í¬µÄI/O±ê×¼£¬Í¨¹ýÈí¼þµÄÁé»îÅäÖã¬¿ÉÆ¥Å䲻ͬµÄµçÆ÷±ê×¼ÓëIOÎïÀíÌØÐÔ£¬¶øÇÒ¿ÉÒÔµ÷ÕûÇý¶¯µçÁ÷µÄ´óС£¬¿ÉÒԸıäÉÏ/ÏÂÀ­µç×裬Cyclone IVÉ豸ÓÐ8¸öIO blank(×é)£¬¼ûÏÂͼ£º

ͼ2 Cyclone IVÉ豸µÄIO×é

2.2 LAB

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ͼ3 LAB½á¹¹Í¼

LEÊÇCyclone IVÉ豸×îСµÄÂß¼­µ¥Ôª£¬Ã¿¸öLEÖ÷ÒªÓÐLUTºÍ¼Ä´æÆ÷×é³ÉµÄ£¬

ͼ4 LEµÄ½á¹¹Í¼

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ͼ5 LUTµÄʵÏÖÔ­Àíͼ

2.3 Interconnect

FPGAÄÚ²¿Á¬½ÓÏߺܷḻ£¬¸ù¾ÝÊý¾ÝÊÖ²áµÄÃèÊö£¬Ö÷ÒªÓÐͼ3ÖеÄRow interconnect¡¢column interconnect¡¢Direct link interconnect¡¢ºÍLocal interconnectºÍRegister chain interconnect(¼Ä´æÆ÷Ö®¼äÁ¬½ÓµÄÁ¬½ÓÏß)¡£

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3.FPGA¹¤×÷Ô­Àí

FPGAÀûÓÃСÐͲéÕÒ±í£¨16¡Á1RAM£©À´ÊµÏÖ×éºÏÂß¼­£¬Ã¿¸ö²éÕÒ±íÁ¬½Óµ½Ò»¸öD´¥·¢Æ÷µÄÊäÈë¶Ë(¼ûͼ4)£¬´¥·¢Æ÷ÔÙÀ´Çý¶¯ÆäËûÂß¼­µç·»òÇý¶¯I/O£¬Óɴ˹¹³ÉÁ˼ȿÉʵÏÖ×éºÏÂß¼­¹¦ÄÜÓÖ¿ÉʵÏÖʱÐòÂß¼­¹¦ÄܵĻù±¾Âß¼­µ¥ÔªÄ£¿é£¬ÕâЩģ¿é¼äÀûÓýðÊôÁ¬Ïß»¥ÏàÁ¬½Ó»òÁ¬½Óµ½I/OÄ£¿é¡£FPGAµÄÂß¼­ÊÇͨ¹ýÏòÄÚ²¿¾²Ì¬´æ´¢µ¥Ôª¼ÓÔØ±à³ÌÊý¾ÝÀ´ÊµÏֵģ¬´æ´¢ÔÚ´æ´¢Æ÷µ¥ÔªÖеÄÖµ¾ö¶¨ÁËÂß¼­µ¥ÔªµÄÂß¼­¹¦ÄÜÒÔ¼°¸÷Ä£¿éÖ®¼ä»òÄ£¿éÓëI/O¼äµÄÁª½Ó·½Ê½£¬²¢×îÖÕ¾ö¶¨ÁËFPGAËùÄÜʵÏֵŦÄÜ£¬FPGAÔÊÐíÎÞÏ޴εıà³Ì¡£

4.FPGA¿ª·¢Á÷³Ì

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ͼ6 FPGAµÄ¿ª·¢Á÷³Ì

1)ϵͳ¹¦ÄÜÉè¼Æ

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2)RTL¼¶HDLÉè¼Æ

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3)RTL¼¶·ÂÕæ

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5)Ãż¶·ÂÕæ

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8)FPGA°å¼¶µ÷ÊÔ

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Âß¼­·ÖÎöÒÇ£¨Logic Analyzer£¬LA£©ÊÇFPGAÉè¼ÆµÄÖ÷Òªµ÷ÊÔ¹¤¾ß£¬µ«ÐèÒªÒý³ö´óÁ¿µÄ²âÊԹܽţ¬ÇÒLA¼Û¸ñ°º¹ó¡£Ä¿Ç°£¬Ö÷Á÷µÄFPGAоƬÉú²úÉ̶¼ÌṩÁËÄÚǶµÄÔÚÏßÂß¼­·ÖÎöÒÇ£¨ÈçXilinx ISEÖеÄChipScope¡¢Altera QuartusIIÖеÄSignalTapIIÒÔ¼°SignalProb£©À´½â¾öÉÏÊöì¶Ü£¬ËüÃÇÖ»ÐèÒªÕ¼ÓÃоƬÉÙÁ¿µÄÂß¼­×ÊÔ´£¬¾ßÓкܸߵÄʵÓüÛÖµ¡£

   
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